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Encoding:
Internet Message Format  |  1996-08-05  |  2.2 KB
  1. Path: pathway1.pathcom.com!ts5l5
  2. From: insystem@pathcom.com (Geoffrey Welsh)
  3. Newsgroups: comp.dcom.modems
  4. Subject: Re: Better UARTs?
  5. Date: 18 Feb 1996 18:04:22 GMT
  6. Organization: InSystems Technologies Inc.
  7. Message-ID: <4g7pn6$9pv@pathway1.pathcom.com>
  8. References: <4g0hq5$166u@usenetw1.news.prodigy.com>
  9. NNTP-Posting-Host: ts2l10.pathcom.com
  10. X-Newsreader: News Xpress Version 1.0 Beta #4
  11.  
  12. In article <4g0hq5$166u@usenetw1.news.prodigy.com>,
  13.    davidsen@tmr.com (bill davidsen) wrote:
  14. >I heard about the 16650 UART some time ago, which has 32 byte FIFOs
  15. >rather than 16. While it sounded interesting, it also didn't seem
  16. >like something I "just had to have." However, now I've seen some
  17. >specs on the 16750 UART. Got to try one of these.
  18. >
  19. >It seems that in addition to a 64 byte FIFO (no surprise) it will do
  20. >the hardware handshake for you! Now the slowest system around will
  21. >not lose data because the UART will drop RTS when the FIFO is almost
  22. >full, and will stop sending if the CTS drops. This is where the
  23. >logic should have been all along, and all I want to know is where to
  24. >find one.
  25.  
  26. I thought that this was also a 16650 feature.
  27.  
  28. As I look over the 16550A spec, I see many things that could have been done to 
  29. improve the original design.  For instance, transmit holding register empty 
  30. interrupts should have been triggered on the same basis as receive data 
  31. interrupts (i.e. when there are 1, 4, 8, or 14 _empty_ places in the FIFO) in 
  32. order to make sure that the system can keep the transmit FIFOs full for best 
  33. transmit speed.  The transmit holding register empty status bit should be set 
  34. as long as there's an open slot in the transmit FIFO, just as the receive data 
  35. status bit is set as long as there's a byte in the receive FIFO.  In other 
  36. words, the 16550 is an asymmetrical chip, and a symmetrical design would have 
  37. been a drastic improvement in both performance and consistency with the 
  38. 8250/16450 functionality.
  39.  
  40. I've tried to find a Startech web page via guide.infoseek.com and other 
  41. search engines, but no luck so far.
  42.  
  43. Geoffrey Welsh, Developer, InSystems Technologies Inc.: insystem@pathcom.com
  44. At home: geoff@zswamp.uucp, [xenitec.on.ca|m2xenix.psg.com]!zswamp!geoff
  45.